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Verilog HDL

简介:Verilog HDL是一种硬件描述语言,以文本形式来描述数字系统硬件的结构和行为的语言,用它可以表示逻辑电路图、逻辑表达式,还可以表示数字逻辑系统所完成的逻辑功能。 Verilog HDL和VHDL是世界上最流行的两种硬件描述语言,都是在20世纪80年代中期开发出来的。前者由Gateway Design Automation公司(该公司于1989年被Cadence公司收购)开发。两种HDL均为IEEE标准。
双线性插值FPGA代码Verilog工程文件
贡献者:wwq123456 更新时间:2019年9月30日 15:27
Verilog版的数字滤波器的MATLAB与fpga的实现
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DDS频率控制器源码Verilog,可调节频率
贡献者:18201036034 更新时间:2019年9月22日 09:26
verilog编写的1024点的fft快速傅立叶变换代码下载
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2048点FFT在FPGA下实现的Verilog程序下载
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数字信号处理fft的verilog应用程序下载
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设计与验证:Verilog HDL高清PDF含程序源码
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ethernet的VERILOG实现含RTL级的Verilog描述
贡献者:牛哞哞咩咩 更新时间:2019年9月15日 21:28
源创客Altium Designer 3D元件PCB封装库
贡献者:yixiudz 更新时间:2019年9月11日 22:21
使用Verilog编写的FPGA流水灯程序,软件为ISE
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CPLD AUTOSAR OpenCV FPGA 51单片机

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